数字集成电路设计热门职位
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前一期E课网为大家介绍了中国集成电路产业面临的发展机遇，而人才正日渐成为制约中国集成电路产业发展的关键因素。本期E课网为大家组织了一些数字集成电路设计相关的热门职位，希望能为大家的学习提供方向，为职业规划提供参考依据。
E课网(www.eecourse.com)平台上提供很多的免费公开课程，其中一门课程就详细介绍了数字集成电路的设计流程。整个数字芯片设计流程可以概括为几个阶段：产品定义-设计-验证-逻辑综合-物理设计-生产制造。随着数字芯片规模的不断增加，可测试性设计(DFT）变成了一个必须的要求。而对于目前正流行的手持移动设备，芯片的低功耗设计成为其成败的关键。数字芯片设计相关的职位自然与芯片设计流程，芯片设计新技术息息相关。
从需求量来看，最热门的两个职位是IC验证(design verification)工程师和IC物理设计(physical design)工程师。IC验证工程师的职责是验证设计实现的功能正确性；需要建立和维护测试环境，测试流程等。据此验证工程师需要掌握至少一种验证方法学(如OVM/VMM/UVMM 等),Verilog及system Verilog更是必备技能，C/C++编程及脚本能力也是完成验证工作的强有力武器。物理设计工程师，顾名思义就是负责芯片的物理实现工作。需要熟悉物理设计的整个流程包括place，routing等，熟练掌握相关EDA工具的用法，时序分析及功耗分析也是必备的技能。物理设计是具体项目实现过程中投入人数最多的阶段。
随着芯片设计规模的日益增加，逻辑综合，形式验证，包括时序分析也形成了专门的岗位需求。E课网的课程体系中把这一部分称之为设计流程中的中端。有的设计公司中把这一岗位称为Front End Integration工程师，负责RTL设计到网表的具体实现，其中考虑面积，时序及功耗等重要因素。形式验证则保证了RTL到NETLIST，Pre-physical到Post-physical NETLIST的功能一致性。
DFT工程师承担着确保芯片质量，降低芯片设计成本等重要职责。除了具有利用Verilog/VHDL实现特定测试逻辑的能力，还要熟悉包括Scan/ATPG/BIST/JTAG等在内的各种DFT技术与方法，以及相关EDA工具的用法。具体DFT实现最终落实在芯片设计流程的各个阶段。
低功耗技术在移动芯片中的广泛应用使得Power工程师变得越来越炙手可热。Power 工程师的职责非常广泛，包括确定芯片的power架构，考虑不同设计层次的 power利用效率，功耗分析及功耗测量等。既要熟练运用UPF/CPF描述设计的power intention外，也要负责power相关设计流程的实现与维护，例如low power simulation，low power verification等。
E课网是一家专注于集成电路设计人才技能培训的在线职业教育平台，包括视频点播平台、视频直播平台、项目实训平台和职业认证平台，提供了涵盖整个IC设计流程的完整培训课程，也覆盖了DFT与基于UPF的low power等新设计技术。E课网为高校提供人才培养方案，为企业输送高端集成电路设计人才，打通从人才入口到出口的通道。
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